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An der TU-Berlin ist die skalare 32-Bit Mikroprozessor-Architektur Nemesis entwickelt und in unterschiedlichen, sich in Komplexität und Geschwindigkeit signifikant unterscheidenden Varianten als IPs (Intellectual Properties) für FPGAs von Xilinx realisiert worden. Dieser Beitrag beschreibt die leistungsfähigste Implementierung Nemesis X, in der durch Verwendung der so genannten Dynamic-Binary-Translation, trotz geringer Komplexität, bis zu drei Instruktionen pro Takt ausgeführt werden.

Mikroprozessor im Hardware-/Software-Codesign (Microprocessor by Hardware-/Software-Codesign): Microprocessor by Hardware-/Software-Codesign