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In diesem Beitrag wird eine neue Technik zur Simulation von DSPArchitekturen mit Pipeline vorgestellt. Im Gegensatz zu existierenden Simulatoren, die auf der interpretierenden Technik aufbauen, basiert unser Simulator auf dem Prinzip der kompilierten Simulation. Im Vergleich zu existierenden interpretierenden Prozessorsimulatoren sind Geschwindigkeitsteigerungen um zwei Größenordnungen bei gleichbleibender Genauigkeit der Simulation möglich. Als Folge dieser Geschwindigkeitssteigerung werden wesentlich kürzere Entwicklungszyklen bei der Entwicklung und Verifikation von DSP-Code möglich. Dieser Beitrag beschreibt die Technik der kompilierten Simulation anhand des TMS320C54x Prozessors von Texas Instruments. Die untersuchten Beispiele zeigen eine Geschwindigkeitssteigerung von 33 bis 155 im Vergleich zum Simulator sim54x von

Schnelle Simulation des TI-TMS320C54x DSP